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低频数模混合模块时钟结构及扫描链设计方法

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本发明提供一种低频数模混合模块时钟结构及扫描链设计方法。其中，将所有寄存器按照顺序分为M组，每个寄存器组中所包含的寄存器数量和该寄存器组所对应的驱动单元的可扇出寄存器的最大数保持一致；每个寄存器组中各个寄存器的时钟树结构采用Z‑H时钟结构；M组寄存器之间的时钟结构，具体为：在第一组寄存器的公共路径上无任何时钟缓冲单元，在第二组寄存器的公共路径上添加有一个第二时钟缓冲单元，在第三组寄存器的公共路径上添加有两个第三时钟缓冲单元，以此类推，直到在作为最后一组寄存器的第M组寄存器的公共路径上添加有M‑1个第M时钟缓冲单元。本发明可以将同时翻转的寄存器数量降到最少，降低设计整体功耗和瞬时功耗。

著录项

公开/公告号CN114239475A

专利类型发明专利
公开/公告日2022-03-25

原文格式PDF
申请/专利权人郑州信大华芯信息科技有限公司;
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申请/专利号CN202111550219.5
发明设计人刘建峰;周朝旭;韩莹莹;胡石闯;赵仲毅;邱博;
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申请日2021-12-17
分类号G06F30/396(20200101);G06F30/398(20200101);G06F30/333(20200101);G06F115/06(20200101);
代理机构41111 郑州大通专利商标代理有限公司;
代理人高为宝
地址 450000 河南省郑州市郑东新区祭城路南、湖心环路西建业智慧大厦3单元8层801号
入库时间 2023-06-19 14:39:06

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2022-03-25

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