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用于数字电路的信号延迟方法、装置及数字电路系统

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本发明提供一种用于数字电路的信号延迟方法、装置及数字电路系统，方法包括：接收待延迟的信号，所述待延迟的信号的待延迟量为n个延迟单位，其中n为自然数；分解出所述待延迟的信号的上升沿和下降沿；通过计数器对所述上升沿和下降沿分别进行n-1个延迟单位的延迟，得到延迟后的上升沿和延迟后的下降沿；将所述延迟后的上升沿和延迟后的下降沿合成，得到所述待延迟的信号延迟了n延迟单位后的信号。采用计数器实现信号的延迟，从而可以用少量的计数器替代寄存器或RAM实现信号的延迟，有效地解决了传统方式通过寄存器、RAM延迟导致的占用资源大的问题。

著录项

公开/公告号CN102684651B

专利类型发明专利
公开/公告日2015-07-08

原文格式PDF
申请/专利权人华为技术有限公司;
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申请/专利号CN201210165584.9
发明设计人苏清博;徐建;
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申请日2012-05-25
分类号H03K5/13(20140101);
代理机构11205 北京同立钧成知识产权代理有限公司;
代理人刘芳
地址 518129 广东省深圳市龙岗区坂田华为总部办公楼
入库时间 2022-08-23 09:27:22

法律信息

法律状态公告日

法律状态信息

法律状态
2015-07-08

授权

授权
2012-11-14

实质审查的生效 IPC(主分类):H03K 5/13 申请日:20120525

实质审查的生效
2012-09-19

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