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采用限缓冲区处理的世界和屏幕空间管线间基元重新排序

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本发明的一个实施例包括用于当渲染图像时处理与高速缓存像素块相关联的图形基元的方法。从图形处理管线的第一部分接收与第一渲染目标配置相关联的图形基元集，并将图形基元集存储在存储器中。检测指示图形基元集准备好用于处理的条件，并选择与图形基元集中的至少一个图形基元相交的高速缓存像素块。与高速缓存像素块相交的、图形基元集中的至少一个图形基元被传送到图形处理管线的第二部分用于处理。所公开的实施例的一个优点是图形基元和相关联的数据在高速缓存像素块渲染期间更可能保持存储在片上，从而减少功耗并改进渲染性能。

著录项

公开/公告号CN103793893B

专利类型发明专利
公开/公告日2017-03-01

原文格式PDF
申请/专利权人辉达公司;
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申请/专利号CN201310518002.5
发明设计人济亚德·S·哈库拉;罗伯特·奥哈内西安;丁提亚·艾利森;戴尔·L·柯克兰;
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申请日2013-10-28
分类号G06T15/00(20110101);G06T15/40(20110101);G06T15/50(20110101);G06T1/20(20060101);G06T1/60(20060101);G06F12/0875(20160101);
代理机构11336 北京市磐华律师事务所;
代理人谢栒;魏宁
地址美国加利福尼亚州
入库时间 2022-08-23 09:53:24

法律信息

法律状态公告日

法律状态信息

法律状态
2017-03-01

授权

授权
2014-06-11

实质审查的生效 IPC(主分类):G06T 5/50 申请日:20131028

实质审查的生效
2014-05-14

公开

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1. 采用限缓冲区处理的世界和屏幕空间管线间基元重新排序 [P] . 中国专利： CN103793893B . 2017.03.01
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3. PRIMITIVE RE-ORDERING BETWEEN WORLD-SPACE AND SCREEN-SPACE PIPELINES WITH BUFFER LIMITED PROCESSING [P] . 美国专利： US2014118381A1 . 2014-05-01

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