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中值滤波器电路结构及中值获取方法

摘要

本发明提供了一种中值滤波器电路结构及中值获取方法,该结构包括:用于存寄存上一周期按大小顺序排列的N‑1个数据的数据寄存器;用于接收第N个数据并将其位宽增加的位宽增加电路;用于对位宽增加电路输出的增加位宽后的第N个数据与数据寄存器中的N‑1个按大小顺序排列的数据进行比较并生成新的顺序的比较及排序电路;以及用于完成数据的衰减和终结并将其余数据存入数据寄存器中的生命周期衰减及终结电路。本发明的中值滤波器电路结构在减小寄存器资源消耗的基础上,减小逻辑电路的复杂度,使得其能够适应更高的时钟速度。

著录项

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2020-05-15

    授权

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  • 2017-07-04

    实质审查的生效 IPC(主分类):G06T1/60 申请日:20161227

    实质审查的生效

  • 2017-06-09

    公开

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