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公开/公告号CN107766259B
专利类型发明专利
公开/公告日2021-08-20
原文格式PDF
申请/专利权人 华为技术有限公司;
申请/专利号CN201610708009.7
发明设计人 蔡卫光;郑礼炳;张惠敏;
申请日2016-08-23
分类号G06F12/1009(20160101);G06F12/1027(20160101);G06F12/109(20160101);
代理机构11329 北京龙双利达知识产权代理有限公司;
代理人毛威;孙涛
地址 518129 广东省深圳市龙岗区坂田华为总部办公楼
入库时间 2022-08-23 12:20:54
机译: 多处理器系统具有高速缓存一致的最小化逻辑,以响应于相应处理器的存储器访问请求而生成用于下一级高速缓存存储器和共享存储单元的直接存储器访问请求
机译: 缓存线之后包括填充页表项的下一条物理顺序缓存线的预取
机译: 在包含已加载的页表项的缓存行之后预取下一个物理顺序的缓存行
机译:哈希,不缓存(页表)
机译:翻译缓存:跳过,不要走路(页表)
机译:NoC和缓存组织的共同设计,用于减少芯片多处理器中的访问延迟
机译:哈希,不要缓存(页表)
机译:动态高速缓存重新配置,用于芯片多处理器中的能源优化。
机译:表达麻疹病毒核衣壳基因的破骨细胞显示出分页表型
机译:在芯片 - 多处理器中写入避免对非易失性存储器中的最后级别缓存的避免高速缓存协调协调协调协议
机译:用于硬件控制的高速缓存一致性的高速缓存组方案以及大规模多处理器中硬件一致性控制的一般需求。