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纠突发差错的循环码并行捕错译码装置

摘要

本发明属于网络通信技术中纠突发性差错的循环码并行捕错译码装置。包括与各条通道分别连接的校验子计算器,均含两套差错计算器及其有效性判决器、差错模式存储器在内的并行设置各通道,多选一选择器,差错纠正器,设于数据接收端与差错纠正器之间的数据循环移位器。该发明由于增设了接收数据循环移位器,并在每条通道内均增设了一套差错计算器及其判决器,可在各通道之间及各通道内同时对数据进行循环移位处理,从而具有在大数据量、高速率通信的情况下译码延时小,译码准确且效率高,而所需并行通道数目少,装置及译码电路结构简单等特点。克服了背景技术装置及译码电路较复杂,易发生差错可纠性的误判及译码差错等缺陷。

著录项

  • 公开/公告号CN101394250B

    专利类型发明专利

  • 公开/公告日2011-02-09

    原文格式PDF

  • 申请/专利权人 电子科技大学;

    申请/专利号CN200810046413.8

  • 发明设计人 谢军;李东;涂晓东;

    申请日2008-10-30

  • 分类号

  • 代理机构

  • 代理人

  • 地址 610054 四川省成都市建设北路二段四号

  • 入库时间 2022-08-23 09:05:54

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2014-12-17

    未缴年费专利权终止 IPC(主分类):H04L 1/00 授权公告日:20110209 终止日期:20131030 申请日:20081030

    专利权的终止

  • 2011-02-09

    授权

    授权

  • 2009-05-20

    实质审查的生效

    实质审查的生效

  • 2009-03-25

    公开

    公开

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