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嵌入式处理器高速协处理器接口

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一种嵌入式处理器高速协处理器接口，包括依次连接的第一级流水线、第二级流水线和第三级流水线，第一级流水线包括协处理器保留栈和指令缓冲器，协处理器接口与外部协处理器数据交互状态时缓存至多两条协处理器指令，从保留栈和指令缓冲器中选取当前可执行的协处理器指令发送至下一级流水线；第二级流水线包括控制逻辑，产生相应的协处理器选择与读写信号，并进行数据通信，当协处理器的数据读写操作完成之后，将得到的结果发送至下一级流水线；第三级流水线向嵌入式处理器发起数据回写请求，并通过通用数据总线将结果返回给嵌入式处理器。本发明提高了CPU和协处理器之间的数据传输速度、提升了处理器的性能。

著录项

公开/公告号CN101526897B

专利类型发明专利
公开/公告日2011-04-20

原文格式PDF
申请/专利权人杭州中天微系统有限公司;
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申请/专利号CN200910095783.5
发明设计人严晓浪;刘磊;葛海通;孟建熠;
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申请日2009-01-22
分类号
代理机构杭州天正专利事务所有限公司;
代理人王兵
地址 310012 浙江省杭州市西湖区华星路99号东部软件园创业大厦A403
入库时间 2022-08-23 09:06:21

法律信息

法律状态公告日

法律状态信息

法律状态
2011-04-20

授权

授权
2009-11-04

实质审查的生效

实质审查的生效
2009-09-09

公开

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