j)i j-th bit and a functional logic structure for generation of a converted carry argument (0j+1→); (j+1)-th bit.;EFFECT: higher efficiency of the process of converting arguments during generation of serial ripple carry.;6 cl"/>
机译:条件“ j + 1”位和参数(0 j Sub>→)的模拟信号的参数(0 j + 1 Sub>→) i Sub>的激活方法序列波纹的条件«j»位的模拟信号的 i Sub> f 1,2 Sub>(←←)±0 Sup>用于转换结构将条件«i»«最小化区域»中的模拟信号的位置符号参数± Sup> [n j Sub>] f(+/-)转换为最小位置符号结构± Sup> [n j Sub>] f(+/-) min Sub>模拟信号及其实现的功能结构(俄罗斯逻辑版本)
公开/公告号RU2425441C2
专利类型
公开/公告日2011-07-27
原文格式PDF
申请/专利权人 PETRENKO LEV PETROVICH;
申请/专利号RU20090132051
发明设计人 PETRENKO LEV PETROVICH;
申请日2009-08-24
分类号H03M7/04;
国家 RU
入库时间 2022-08-21 17:48:17