Optimal design of loop bandwidth in GPS/INS deeply integration

机译：GPS / INS深度集成中环路带宽的优化设计

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The typical tracking loops of the GPS/INS deeply integration are unable to track the signals under high dynamic environments. The crux of the integrated system performance is the low-order phase-locked loops (PLL). Once the environmental dynamics exceed a threshold, the tracking loops will lose the assistance of GPS. The conflict between the ability to track the signal and improving PLL tracking performance should be compromised in PLL design. Aiming at this issue, the design of loop bandwidth is vitally important in the GPS/INS integrated system design. To achieve the successful performance, this paper presents the deeply integration tracking loop design based on a third-order PLL, also included is the stability analysis of the tracking loop. Experimental result shows that the bandwidth of such type of tracking loops could be lower than 3Hz.

机译：GPS / INS深度集成的典型跟踪回路无法在高动态环境下跟踪信号。集成系统性能的关键是低阶锁相环（PLL）。一旦环境动态超过阈值，跟踪循环将失去GPS的帮助。跟踪信号的能力与改善PLL跟踪性能之间的冲突应在PLL设计中加以解决。针对这个问题，环路带宽的设计在GPS / INS集成系统设计中至关重要。为了获得成功的性能，本文提出了基于三阶PLL的深度集成跟踪环路设计，还包括跟踪环路的稳定性分析。实验结果表明，此类跟踪环路的带宽可能低于3Hz。

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来源
《2013 International Workshop on Microwave and Millimeter Wave Circuits and System Technology》|2013年|181-183|共3页
会议地点 Emeishan(CN)
作者
XinChun Zhang; ChengJun Guo;
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作者单位

Research Institute of Electronic Science and Technology, University of Electronic Science and Technology of China, Chengdu 611731, Chinac;

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会议组织
原文格式 PDF
正文语种 eng
中图分类
关键词
Bode diagram; Tracking loops; deeply integration; phase-locked loops; stability condition;

机译：伯德图;跟踪环;深度集成;锁相环;稳定性条件;;

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