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一个并行高速乘法器芯片的设计与实现

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摘要

本文介绍了一种并行高速乘法器的设计原理与方法。该乘法器基于一片ＦＰＧＡ芯片实现，应用在通用数字神经处理芯片中，运作良好，工作主频可达３０ＭＨＺ，达到了预期的目标。同时，这个高速乘法器也可用作ＤＳＰ数字信号处理器的基本运算单元。

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来源
《计算机工程与科学》 |1997年第4期|57-61|共5页
作者
罗莉; 胡守仁;
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作者单位

国防科技大学计算机学院;

国防科技大学计算机学院;

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原文格式 PDF
正文语种 CHI
中图分类 TP332.22;
关键词
乘法器; 并行乘法器; 芯片; 设计;

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