多时钟域处理器架构的性能和功耗分析

朱晓冬; 王世明

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研究一种新的多时钟域的处理器架构,它把处理器分成几个工作在不同时钟下的时钟域,每个域有自己独立的工作电压和时钟频率,可以大大缓解高速处理器设计中最棘手的全局时钟分布问题,并且每个域的工作电压和工作频率可以根据应用的实际需求动态地调整,可以平均节省约20%的功耗.此外分析了全局异步局部同步时钟方案的结构及电压和工作频率调整的算法,并给出用SimpleScalar和Wattch仿真工具得到的仿真结果.

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来源
《计算机工程》 |2005年第24期|75-77|共3页
作者
朱晓冬; 王世明;
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作者单位

上海交通大学电子工程系;

上海;

200030;

上海交通大学电子工程系;

上海;

200030;

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原文格式 PDF
正文语种 chi
中图分类设计;
关键词
处理器; 多时钟域; 低功耗;

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