一种超小型AES专用处理器的FPGA实现

张巨英; 王和明

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一种超小型AES专用处理器的FPGA实现

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提出一种基于FPGA的专用处理器设计.它是用于高级加密标准的超小面积设计,支持密钥扩展(现在设计为128位密钥),加密和解密.这个设计采用了完全的8位数据路径宽度,创新的字节替换电路和乘累加器结构,在最小规模的Xilinx Spartan II FPGA芯片XC2S15上实现了一个高级加密标准AES的专用处理器,使用了不到60%的资源.当时钟为70MHz时,可以达到平均加密解密吞吐量2.1Mb/s.主要应用在把低资源占用,低功耗作优先考虑的场合.

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来源
《微电子学与计算机》 |2008年第4期|165-168|共4页
作者
张巨英; 王和明;
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作者单位

空军工程大学导弹学院;

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原文格式 PDF
正文语种 chi
中图分类各种微型计算机;
关键词
高级加密标准(AES); 专用处理器(ASIP); FPGA; 小面积; 8位;

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