忆阻器的三值逻辑门和加法器设计

钟悦航; 武继刚; 刘鹏; 姚廉

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忆阻器的三值逻辑门和加法器设计

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现有忆阻器的三值逻辑电路设计中无法级联且无法保存输入输出值,导致面积开销和功耗增加.通过对忆阻器辅助逻辑进行扩展,设计了忆阻器的三值逻辑门,具备三值逻辑的完备性.在此基础上设计实现了三值译码器和三值加法器.使用Spice仿真软件对所设计的电路进行了验证.结果表明:与已有的文献进行比较,所提出的电路面积和功耗有所减少.

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来源
《微电子学与计算机》 |2021年第7期|60-66|共7页
作者
钟悦航; 武继刚; 刘鹏; 姚廉;
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作者单位

广东工业大学计算机学院;

广东广州510006;

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原文格式 PDF
正文语种 chi
中图分类电子数字计算机（不连续作用电子计算机）;
关键词
忆阻器; 三值逻辑; 加法器; Spice;

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