SM3杂凑算法的ASIC设计和实现

张倩; 李树国

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针对国家商用密码SM3杂凑算法提出了一种四合一的ASIC实现架构.该架构采用进位保留加法器和循环展开方式,与单轮结构相比,时钟周期数减少了75%,吞吐率提高了29.4%.采用65nm的SMIC工艺,在125MHz的低时钟频率下,吞吐率达到了4Gb/s.此款SM3杂凑算法芯片已经进行了流片,支持填充和暂停功能.

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来源
《微电子学与计算机》 |2014年第9期|143-146|共5页
作者
张倩; 李树国;
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作者单位

清华大学微电子所;

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原文格式 PDF
正文语种 chi
中图分类设计;
关键词
SM3; 杂凑算法; ASIC实现; 填充;

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