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基于FPGA的六级流水线MIPS处理器设计

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设计出了一种兼容MIPS指令集的32位六级流水线嵌入式处理器.六级流水线的划分平衡了各个阶段的任务.并详细介绍了数据冲突和控制冲突的解决方法.该处理器使用FPGA实现,在DE2芯片上的运行时钟频率可达81.7 MHz.最后给出了设计的综合结果,并对该设计进行了软件仿真和硬件验证.

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来源
《微电子学与计算机》 |2015年第4期|31-34|共5页
作者
孙巧稚; 施慧彬;
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作者单位

南京航空航天大学计算机科学与技术学院;

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原文格式 PDF
正文语种 chi
中图分类运算器和控制器（CPU）;
关键词
MIPS; 流水线处理器; 冲突; FPGA;

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