基于流水线的复数阵列加法器的设计与实现

马龙龙; 李云; 冯增喜

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基于流水线的复数阵列加法器的设计与实现

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复数加法运算复杂,用硬件实现复数加法,需要使用数目众多的加法器,占用大量的面积.通过分析复数加法的运算过程,将计算过程流水化,对各加法器进行有效的复用,设计了一个阵列加法器的电路结构实现其功能,并将其用Verilog硬件设计语言描述后,在Modelsim 6.0中完成了功能验证,在Syplify Pro 7.0中完成了电路综合,并采用ISE 7.1完成了布局布线.功能验证、电路综合及布局布线的结果表明设计正确,实现了复数加法运算,时序性能好,耗用资源少.

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来源
《科学技术与工程》 |2007年第12期|2863-28662871|共5页
作者
马龙龙; 李云; 冯增喜;
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作者单位

西北工业大学,西安,710065;

西北工业大学,西安,710065;

西北工业大学,西安,710065;

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原文格式 PDF
正文语种 chi
中图分类 TP332.21;
关键词
加法器; 超前进位; 复数阵列; 流水线;

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