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神经网络电路以及神经网络集成电路

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摘要

提供一种大幅缩小电路规模以及成本、具有高效且多样性的神经网络电路。该神经网络电路具备：记忆单元(1)，用于实现将1位的输入数据(I)与加权系数(W)进行相乘的乘算功能且与输入数据(I)的数量相同；以及多数判定电路(2)，用于实现将各记忆单元(1)中的乘算结果进行相加且将激活函数应用于该加算结果并输出1位的输出数据的加算/应用功能。各记忆单元(1)存储作为“1”或“0”的加权系数、或“NC”的任意一个，在输入数据(I)＝存储值的情况下输出“1”，在输入数据(I)的值≠存储值的情况下输出“0”，在存储了“NC的情况下对其进行输出。多数判定电路(2)基于输出“1”的记忆单元(1)的总数与输出“0”的记忆单元(1)的总数而输出“1”或“0”。

著录项

公开/公告号CN109478253A

专利类型发明专利
公开/公告日2019-03-15

原文格式PDF
申请/专利权人国立大学法人北海道大学;
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申请/专利号CN201780044678.1
发明设计人本村真人;
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申请日2017-05-19
分类号
代理机构北京市柳沈律师事务所;
代理人金兰
地址日本北海道
入库时间 2024-02-19 08:29:09

法律信息

法律状态公告日

法律状态信息

法律状态
2020-05-15

专利申请权的转移 IPC(主分类):G06N3/063 登记生效日:20200426 变更前: 变更后: 申请日:20170519

专利申请权、专利权的转移
2019-04-26

实质审查的生效 IPC(主分类):G06N3/063 申请日:20170519

实质审查的生效
2019-03-15

公开

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