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执行打包数据元素的带符号和无符号双乘法的设备与方法

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摘要

一种用于执行打包的数据元素的双并发乘法的设备和方法。例如，处理器的一个实施例包括：解码器，用来解码第一指令以生成解码的指令；第一源寄存器，存储第一多个打包的数据元素；第二源寄存器，存储第二多个打包的数据元素；执行电路，执行所述经解码的指令，执行电路包括：乘法器电路，执行来自第一源寄存器的第一打包的数据元素与来自第二源寄存器的第二打包的数据元素和来自第一源寄存器的第三打包的数据元素与来自第二源寄存器的第四打包的数据元素的并发双乘法以分别生成第一和第二积；所述乘法器电路用来根据立即数从第一源寄存器选择第一和第三打包的数据元素并且从第二源寄存器选择第二和第四打包的数据元素以生成第一和第二积。

著录项

  • 公开/公告号CN109582363A

    专利类型发明专利

  • 公开/公告日2019-04-05

    原文格式PDF

  • 申请/专利权人 英特尔公司;

    申请/专利号CN201811131679.2

  • 发明设计人 V.马杜里;E.奥德-艾哈迈德-瓦尔;J.科巴尔;M.查尼;R.瓦伦丁;B.杨;

    申请日2018-09-27

  • 分类号G06F9/30(20060101);

  • 代理机构72001 中国专利代理(香港)有限公司;

  • 代理人姜冰;杨美灵

  • 地址 美国加利福尼亚州

  • 入库时间 2024-02-19 09:09:06

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2019-04-05

    公开

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