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数字电子装置以及改变数字电子装置中的时钟延迟的方法

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一种数字电子装置具有第一顺序逻辑单元(SS1)和第二顺序逻辑单元(SS2)，每个顺序逻辑单元用于接收输入信号(D)和分别输出第一输出信号(Q)和第二输出信号(QF)。该电子装置还包括用于对第一输出信号(Q)和第二输出信号(QF)进行比较的比较器单元(C)和分别产生用于第一顺序逻辑单元(SS1)和第二顺序逻辑单元(SS2)的第一内部时钟(CK)和第二内部时钟(CKF)。在自校正模式下，自适应时钟发生器单元(ACG)适于相对于另一个内部时钟信号(CKF)对第一或第二内部时钟信号(CK，CKF)进行延迟。自适应时钟发生器单元(ACG)所引起的延迟取决于比较器单元(C)的结果。在正常工作模式下，自适应时钟发生器单元(ACG)适于保持第一内部时钟信号和第二内部时钟信号之间延迟的恒定。

著录项

公开/公告号CN101606318A

专利类型发明专利
公开/公告日2009-12-16

原文格式PDF
申请/专利权人 NXP股份有限公司;
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申请/专利号CN200880004330.0
发明设计人樊尚·于阿尔;
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申请日2008-01-31
分类号H03K5/135;G06F1/04;H04L7/033;
代理机构北京天昊联合知识产权代理有限公司;
代理人陈源
地址荷兰艾恩德霍芬
入库时间 2023-12-17 23:14:27

法律信息

法律状态公告日

法律状态信息

法律状态
2017-03-29

未缴年费专利权终止 IPC(主分类):H03K5/135 授权公告日:20121031 终止日期:20160131 申请日:20080131

专利权的终止
2012-10-31

授权

授权
2010-02-10

实质审查的生效

实质审查的生效
2009-12-16

公开

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1. 数字电子装置以及改变数字电子装置中的时钟延迟的方法 [P] . 中国专利： CN101606318A . 2009-12-16
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