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减少处理引擎中的加载-存储冲突惩罚的系统和方法

摘要

一种用于乱序处理引擎的加载‑存储冲突检测系统,包括:调度器,向多个指令流水线派遣指令。指令流水线包括当执行推定派遣的加载指令时提供加载有效信号的加载流水线。加载‑存储冲突检测系统包括比较逻辑、广播逻辑和阻止逻辑。当推定派遣的加载指令的加载指令虚拟地址与先前派遣的且对应数据尚未准备好的存储指令的至少一个存储指令虚拟地址匹配时,比较逻辑声明清除信号。广播逻辑向调度器广播加载有效信号,以使能依赖于推定派遣的加载指令的任何指令的派遣。当清除信号被声明时,阻止逻辑无效加载有效信号,以避免降低处理性能的加载‑存储冲突。

著录项

  • 公开/公告号CN104808996B

    专利类型发明专利

  • 公开/公告日2018-08-31

    原文格式PDF

  • 申请/专利权人 上海兆芯集成电路有限公司;

    申请/专利号CN201510229378.3

  • 发明设计人 邸千力;王健斌;高新宇;

    申请日2015-05-07

  • 分类号G06F9/54(20060101);G06F9/455(20060101);

  • 代理机构11105 北京市柳沈律师事务所;

  • 代理人钱大勇

  • 地址 上海市张江高科技园区金科路2537号301室

  • 入库时间 2022-08-23 10:15:56

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2018-08-31

    授权

    授权

  • 2015-08-26

    实质审查的生效 IPC(主分类):G06F9/44 申请日:20150507

    实质审查的生效

  • 2015-07-29

    公开

    公开

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