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全同步数字频率计的VHDL设计与仿真

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摘要

利用全同步频率测量原理,通过FPGA芯片在Max+Plus Ⅱ中运用VHDL语言编程设计一个全同步数字式频率计,消除了±1个计数误差,测频精度范围在DC～100 MHz,详细给出了VHDL的模块设计方法和仿真波形.

著录项

来源
《现代电子技术》 |2007年第20期|176-178|共3页
作者
包本刚; 何怡刚; 朱湘萍;
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作者单位

湖南科技学院,湖南,永州,425100;

湖南大学,电气学院,湖南,长沙,410082;

湖南科技学院,湖南,永州,425100;

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原文格式 PDF
正文语种 chi
中图分类振荡技术;
关键词
FPGA; 全同步; 频率计; VHDL;

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