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丁婷婷; 申敏;
重庆邮电大学,重庆,400065;
RFAD; drv clk; burst; A/D;
机译:自适应子电路和紧凑的Verilog-A宏模型作为Qucs电路仿真中的集成设计和分析模块
机译:计算机验证和应用于过程控制系统的新趋势:第38届GAMP4(14)概述“附录D5软件设计规范/软件模块设计规范创建过程示例”
机译:计算机验证和在过程控制系统中的应用的新趋势:第37届GAMP4概述(13)“附录D2功能规范创建过程示例”和“附录D3硬件设计规范”概述
机译:MDAB:使用系统Verilog Testbench进行验证的模块设计自动化模块
机译:设计2D功能材料用于未来的微电子应用=未来微电子应用的2D功能材料设计
机译:评估基于任务的功能磁共振成像研究的多回波ICA降噪:模块设计与事件相关的快速设计和门控功能磁共振成像
机译:JR椎骨假体:模块化,解剖学和可扩展的装置,具有笼功能和临时设计的板,可在手术后稳定柱。JR椎骨假体:模块化,解剖学和可扩展的装置,具有笼和板功能,可根据需要设计JR肢体切除术椎体假体后可稳定脊柱:模块化,解剖学和可扩展装置,具有笼式功能和双板设计,可在肢体切除术后稳定脊柱
机译:项目经理的支持系统(pmss)。功能模块的执行概述和描述。
机译:Spice到Verilog网表转换器以及使用Spice进行Verilog和Verilog进行Spice翻译的设计方法
机译:集成了智能元模型的Verilog-AMS,可进行快速准确的模拟模块设计探索
机译:模块化设计的全球定位系统接收器,例如导航应用程序,具有用于可交换插件模块的扩展接口,可以使用这些接口来更新接收器功能
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