首页> 中国专利> 通过组合选择性外延和共形外延的用于CMOS的图案化硅衬底上的非硅器件异质层

通过组合选择性外延和共形外延的用于CMOS的图案化硅衬底上的非硅器件异质层

摘要

在于浅沟槽隔离(STI)区之间形成的沟槽中的一个或一对的底部处从衬底表面外延地生长单个鳍状物或一对共集成的n-型和p-型单晶电子器件鳍状物。对一个或多个鳍状物进行图案化并对STI区进行蚀刻,以形成在STI区的经蚀刻的顶部表面之上延伸的一个或多个鳍状物的高度。鳍状物高度可以是鳍状物宽度的至少1.5倍。以一种或多种共形外延材料外延地包覆每一个鳍状物的暴露的侧壁表面和顶部表面,以在鳍状物上形成器件层。在生长鳍状物之前,可以从衬底表面生长均厚缓冲外延材料;并且在于均厚层之上形成的STI沟槽中生成鳍状物。这种鳍状物的形成降低了来自材料界面晶格失配的缺陷。

著录项

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2020-01-10

    发明专利申请公布后的驳回 IPC(主分类):H01L21/336 申请公布日:20160427 申请日:20130927

    发明专利申请公布后的驳回

  • 2016-09-21

    实质审查的生效 IPC(主分类):H01L21/336 申请日:20130927

    实质审查的生效

  • 2016-04-27

    公开

    公开

相似文献

  • 专利
  • 中文文献
  • 外文文献
获取专利

客服邮箱:kefu@zhangqiaokeyan.com

京公网安备:11010802029741号 ICP备案号:京ICP备15016152号-6 六维联合信息科技 (北京) 有限公司©版权所有
  • 客服微信

  • 服务号