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具有并行延迟线和诸延迟线之间的内部开关的延迟电路、以及用于控制该延迟电路的方法和装备

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摘要

本文描述了用于延迟控制的系统和方法。在一个实施例中，延迟电路包括第一延迟路径和第二延迟路径。该延迟电路还包括多个开关，其中每个开关耦合在该第一和第二延迟路径上的不同点之间，并且每个开关配置成响应于多个选择信号中的对应一者而导通或关断。该延迟电路进一步包括复用器，该复用器具有耦合到该第一延迟路径的输出的第一输入、耦合到该第二延迟路径的输出的第二输入、以及耦合到该延迟电路的输出的输出，其中该复用器配置成响应于第二选择信号而选择性地将该第一和第二延迟路径的输出中的一者耦合到该延迟电路的输出。

著录项

公开/公告号CN106716537B

专利类型发明专利
公开/公告日2020-04-10

原文格式PDF
申请/专利权人高通股份有限公司;
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申请/专利号CN201580049688.5
发明设计人 G·辛格;Y·C·程;J·C·迪范德佛;V·斯里尼瓦斯;R·W·C·金;
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申请日2015-07-22
分类号
代理机构上海专利商标事务所有限公司;
代理人袁逸
地址美国加利福尼亚州
入库时间 2022-08-23 10:54:47

法律信息

法律状态公告日

法律状态信息

法律状态
2020-04-10

授权

授权
2017-06-16

实质审查的生效 IPC(主分类):G11C7/10 申请日:20150722

实质审查的生效
2017-06-16

实质审查的生效 IPC(主分类):G11C 7/10 申请日:20150722

实质审查的生效
2017-05-24

公开

公开
2017-05-24

公开

公开

相似文献

专利
中文文献
外文文献

1. 具有并行延迟线和诸延迟线之间的内部开关的延迟电路、以及用于控制该延迟电路的方法和装备 [P] . 中国专利： CN106716537B . 2020.04.10
2. 具有并行延迟线和诸延迟线之间的内部开关的延迟电路 [P] . 中国专利： CN106716537A . 2017-05-24
3. DELAY CIRCUIT WITH PARALLEL DELAY LINES AND INTERNAL SWITCHES BETWEEN THE DELAY LINES [P] . 欧洲知识产权局专利： EP3195317B1 . 2018-12-26

机译：具有并行延迟线和延迟线之间的内部开关的延迟电路
4. DELAY CIRCUIT WITH PARALLEL DELAY LINES AND INTERNAL SWITCHES BETWEEN THE DELAY LINES [P] . IN201747004409A . 2017-05-26

机译：具有并行延迟线和延迟线之间的内部开关的延迟电路
5. DELAY CIRCUIT WITH PARALLEL DELAY LINES AND INTERNAL SWITCHES BETWEEN THE DELAY LINES [P] . 欧洲知识产权局专利： EP3195317A1 . 2017-07-26

机译：具有并行延迟线和延迟线之间的内部开关的延迟电路