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基于SystemVerilog的事务级建模在FPGA测试中的应用与研究

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摘要

随着FPGA的广泛应用,其设计规模和复杂度也急剧增加,FPGA测试的效率也有待进一步提高.研究了基于SystemVerilog的事务级建模,并结合具体实例研究了其在FPGA测试中的应用.研究表明,基于SystemVerilog的事务级建模可重用性强,使用方便,可使FPGA的测试效率得到极大提高.

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来源
《微计算机信息》 |2016年第23期|116-117|共2页
作者
李敬磊; 尹新; 曾清乐;
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作者单位

工业和信息化部电子第五研究所,广东广州510610;

工业和信息化部电子第五研究所,广东广州510610;

工业和信息化部电子第五研究所,广东广州510610;

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原文格式 PDF
正文语种 chi
中图分类大规模集成电路、超大规模集成电路;
关键词
现场可编程逻辑器件; SystemVerilog; ASIC; CPU;

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