基于ADSP21160的高速并行信号处理板设计

蒙修德; 张庆祥

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基于ADSP21160的高速并行信号处理板设计

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利用4片ADSP22l160处理器设计雷达高速并行信号处理根，整板的峰值运算能力达2400MFLOPS。处理根间可通过链接口及VME总线接口通信，板间数据吞吐量达1280MBytes/s，基于该信号处理根易于构成完整的高性能并行信号处理系统。运用高速电路设计方法设计电路，进行信号完整性分析和仿真，保证了设计的质量。

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来源
《中国雷达》|2003年第2期|36-39,50|共5页
作者
蒙修德; 张庆祥;
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作者单位

哈尔滨工业大学电子工程技术研究所;

哈尔滨150001;

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原文格式 PDF
正文语种 CHI
中图分类雷达电子电路装置;
关键词
ADSP21160; 信号处理板; 并行处理; 高速设计; 信号完整性; 雷达; 电路设计;

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